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sim-sim

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HDL Analyzer und Netlist Architect (HANA): Ein Open-Source-Analyse- und Synthesetool für Design, geschrieben in Verilog 2001 HDL

VERSIONSVERLAUF

  • Version releases veröffentlicht auf 2011-02-18
    Mehrere Korrekturen und Updates
  • Version N/A veröffentlicht auf 2011-02-18

Programmdetails

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