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Signs - VHDL Hardware Developement 0.6.3

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Signs ist eine Entwicklungsumgebung für Hardwaredesigns in VHDL und anderen Hardwarebeschreibungssprachen. Es bietet Synthese- und Simulationswerkzeuge, die vollständig in ein Eclipse-Plugin integriert sind, einschließlich grafischer Netzlisten und Wellenform-Viewer.

VERSIONSVERLAUF

  • Version 0.6.3 veröffentlicht auf 2007-01-11
    Mehrere Korrekturen und Updates
  • Version 0.6.3 veröffentlicht auf 2007-01-11

Programmdetails

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