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DSP-GaTech-ECE6276A

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In diesem Projekt wird ein DSP-Prozessor entwickelt, der für FIR/IIR/DCT-Operationen optimiert ist. Die Codierung erfolgt in VHDL und soll von Altera Quartus II synthetisiert werden.

VERSIONSVERLAUF

  • Version initial veröffentlicht auf 2004-11-24
    Mehrere Korrekturen und Updates
  • Version N/A veröffentlicht auf 2004-11-24

Programmdetails

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